A抽象階梯：你缺的是「中間那幾層」
你卡的不是不夠強——MOSFET 的 device 物理你天天在做。缺的只是「從一顆電晶體爬到 ALU」的中間數位抽象層。下面就是這座階梯，由下而上，也是建議的學習順序。從 Tier 1 的 Inverter 開始爬，CP 值最高。
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MOSFET 當開關 你已經會
你早就在操作（source follower / transfer gate / reset gate）。只差換視角：不取中間類比區，只取「全關＝0／全開＝1」。
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▲ 1 PMOS + 1 NMOS 疊起來
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CMOS Inverter 反相器 先學這個
數位電路的「氫原子」。學會讀它＝會讀 90% 的 CMOS 電路圖。下面 B 段你可以親手切換它的輸入。
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▲ 幾顆電晶體排成 pull-up / pull-down
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NAND / NOR 邏輯閘
組合邏輯（output 只看當下 input、沒記憶）。掌握真值表 +「NAND 是萬能閘」就夠。
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▲ 兩個 inverter 頭尾交叉接
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Latch → Flip-flop 正反器
「記憶」的躍遷：交叉耦合會互鎖、把 1 bit 卡住＝你看過的 6T SRAM 核心。Flip-flop＝加時脈的儲存格＝暫存器。
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▲ 一堆閘 / 一堆 flip-flop 拼起來
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ALU ／ Register 大積木
知道由前面的層拼成即可，不必逐顆電晶體讀。ALU＝會算、Register＝會記。
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一句話記住分工：組合邏輯（閘 / ALU）＝算盤（算完就忘）；時序邏輯（latch / FF / register）＝便利貼（記住）。這就是晶片裡的「算的細胞 + 記的細胞」。
B第一關：Inverter ＋ 讀電路圖的萬能鑰匙
這是整套的破關點。先記住這把鑰匙，再親手切換下面的輸入，看 PMOS / NMOS 哪個「通」、OUT 怎麼翻。
🗝️ 讀任何 CMOS 邏輯閘，照這四步
- 找 VDD（最上＝電源）和 GND（最下＝地）——電路圖永遠上電源、下接地
- 上半部全是 PMOS ＝ pull-up network（負責把 OUT 拉高到 1）
- 下半部全是 NMOS ＝ pull-down network（負責把 OUT 拉低到 0）
- OUT 在中間——問自己：這組 input 下，是上面通（→ 輸出 1）還是下面通（→ 輸出 0）？
👉 一句話：上拉到 1、下拉到 0，看哪邊的開關通。
| IN | OUT | 誰在通 |
|---|
| 0 | 1 | PMOS（上拉） |
| 1 | 0 | NMOS（下拉） |
關鍵反直覺：PMOS「閘＝0 才通」、NMOS「閘＝1 才通」。所以輸入 0 → 上面通 → 輸出 1；輸入 1 → 下面通 → 輸出 0。進什麼出相反，這就是「反相器」。
C往上一層：邏輯閘（組合邏輯）
把幾顆電晶體排成不同的 pull-up / pull-down，就得到不同的閘。輸出只看當下輸入、沒有記憶，這叫組合邏輯。用同一把鑰匙就能讀。
NAND（且非）
用鑰匙讀：pull-down 是兩個 NMOS 串聯——A 和 B 都＝1 才通、把 OUT 拉到 0；其餘情況上拉到 1。
NOR（或非）
pull-down 是兩個 NMOS 並聯——A 或 B 任一＝1 就通、拉到 0；只有都＝0 才上拉到 1。
只要會 NAND 就夠了：NAND 是「萬能閘」——只用 NAND 可以堆出 inverter、AND、OR、所有邏輯。所以你不必背每種閘的接法，先掌握真值表 + 鑰匙判讀法。
D記憶的躍遷：兩個 inverter 互鎖
前面都是「算完就忘」。要能記住，關鍵動作只有一個：把兩個 inverter 頭尾交叉接起來，它們會互相餵對方、彼此鎖死，把 1 個 bit 卡住不放。
這就是你看過的 6T SRAM 核心！那兩個 INV + cross-coupled latch，加上 2 顆存取電晶體（M5/M6）控制讀寫，就是一顆 6T SRAM cell。再加上時脈（clock）、變成邊緣觸發的 Flip-flop，就是暫存器（register）的基本格。感測的細胞是 4T 像素、記憶的細胞就是這個。
E頂層：拼成 ALU 與 Register
到這裡你已經有全部零件了。最上層只是「大量組裝」，不需要再逐顆電晶體讀：
ALU（會算）
用一堆邏輯閘拼出加法器、比較器、邏輯運算——純組合邏輯，輸入進、結果出，不記。
Register / SRAM（會記）
用一堆flip-flop / 交叉 inverter拼成——時序邏輯，把資料鎖住，要用時再讀出。
回到大圖：CPU 核心＝ALU（算）+ 暫存器（記）+ L1 cache（6T SRAM）。你在 SoC 地圖看到的每個方塊，拆到底都是這頁的這幾種積木堆出來的。